文件名称:dss_201403

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2014-04-15
  • 文件大小:
  • 11kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 张*
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  • 下载说明:
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介绍说明--下载内容均来自于网络,请自行研究使用

使用verilog编写的,测试用多路串口通信信号源,用于fpga产生多路测试用串口信号,配置外围电平转换电路可以设计一个多路可编程数字信号源-Use verilog written, multiple serial communication test signal source for generating multiple test fpga serial signal, configure the external level shifting circuitry can design a multi-channel programmable digital signal source
(系统自动生成,下载前可以参看下载内容)

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sete.v

testtop1.v

testtop.v

dsstop.v

out.v

set.v

seta.v

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