设计与验证Verilog-光盘\Example-2-1\HelloVlog.v

......................\........3-1\FullAdd.v

......................\...........\transcript

......................\..........2\FullAdd.v

......................\..........3\CRC10.v

......................\........4-1\cnt.prd

......................\...........\cnt.prj

......................\...........\rev_1\cnt1.edf

......................\...........\.....\cnt1.fse

......................\...........\.....\cnt1.srm

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......................\...........\.....\......\cnt2.msg

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......................\...........\.....\......\cnt3.msg

......................\...........\.....\......\cnt3.plg

......................\...........\source\cnt1.v

......................\...........\......\cnt2.v

......................\...........\......\cnt3.v

......................\...........\......\syntmp.msg

......................\...........\示例说明.doc

......................\...........0\bibus\bibus.prd

......................\............\.....\bibus.prj

......................\............\.....\bibus.v

......................\............\.....\decode.v

......................\............\.....\rev_1\bibus.fse

......................\............\.....\.....\bibus.srd

......................\............\.....\.....\bibus.srm

......................\............\.....\.....\bibus.srr

......................\............\.....\.....\bibus.srs

......................\............\.....\.....\bibus.sxr

......................\............\.....\.....\bibus.tcl

......................\............\.....\.....\bibus.tlg

......................\............\.....\.....\bibus.vqm

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......................\............\.....\.....\bibus_cons.tcl

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......................\............\.....\.....\rpt_bibus.areasrr

......................\............\.....\.....\rpt_bibus_areasrr.htm

......................\............\.....\.....\syntmp\bibus.msg

......................\............\.....\.....\......\bibus.plg

......................\............\.....\.....\......\bibus_cons_ui.tcl

......................\............\.....\.....\verif\bibus.vif

......................\............\.....\syntmp.msg

......................\............\complex_bibus\complex_bibus.prd

......................\............\.............\complex_bibus.prj

......................\............\.............\complex_bibus.v

......................\............\.............\complex_bibus2.v

......................\............\.............\counter.v

......................\............\.............\decode.v

......................\............\.............\rev_1\AutoConstraint_complex_bibus.sdc

......................\............\.............\.....\complex_bibus.fse

......................\............\.............\.....\complex_bibus.srd

......................\............\.............\.....\complex_bibus.srm

......................\............\.............\.....\complex_bibus.srr

......................\............\.............\.....\complex_bibus.srs

......................\............\.............\.....\complex_bibus.sxr

......................\............\.............\.....\compl