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文件名称:std_logic_arith

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2014-05-23
  • 文件大小：
  • 7kb
  • 下载次数：
  • 1次
  • 提 供 者：
  • 以**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

描述了VHDL加减乘除的最基本的操作，包括重载，最底层的实现，是理解一门语言的最好的途径-VHDL descr iption of the basic operations of addition, subtraction, including overloading, the underlying implementation is the best way to understand a language
(系统自动生成,下载前可以参看下载内容)

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std_logic_arith.vhd

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