文件名称:SignalTap-II

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2013-06-25
  • 文件大小:
  • 24.54mb
  • 下载次数:
  • 0次
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FPGA应用开发入门与典型实例代码,典型实例9 SignalTap II 功能演示-FPGA Application Development and Typical examples of code, typical examples 9 SignalTap II functional demo
(系统自动生成,下载前可以参看下载内容)

下载文件列表





典型实例9 SignalTap II 功能演示\典型实例9 SignalTap II 功能演示\S3_WAVE\PROJ\cmp_state.ini

...............................\...............................\.......\....\COUNTER.bsf

...............................\...............................\.......\....\COUNTER.v

...............................\...............................\.......\....\COUNTER_bb.v

...............................\...............................\.......\....\COUNTER_wave0.jpg

...............................\...............................\.......\....\COUNTER_waveforms.html

...............................\...............................\.......\....\div.bsf

...............................\...............................\.......\....\div.v

...............................\...............................\.......\....\h.bsf

...............................\...............................\.......\....\h.v

...............................\...............................\.......\....\h_bb.v

...............................\...............................\.......\....\insystem.bmp

...............................\...............................\.......\....\PROJ.rar

...............................\...............................\.......\....\ROM.bsf

...............................\...............................\.......\....\ROM.v

...............................\...............................\.......\....\ROM_bb.v

...............................\...............................\.......\....\serv_req_info.txt

...............................\...............................\.......\....\signal-tap.bmp

...............................\...............................\.......\....\..mulation\modelsim\cyclone_atoms.v

...............................\...............................\.......\....\..........\........\vsim.wlf

...............................\...............................\.......\....\..........\........\wave.do

...............................\...............................\.......\....\..........\........\WAVE.vo

...............................\...............................\.......\....\..........\........\WAVE_modelsim.xrf

...............................\...............................\.......\....\..........\........\wave_test.cr.mti

...............................\...............................\.......\....\..........\........\wave_test.mpf

...............................\...............................\.......\....\..........\........\WAVE_TOP.V

...............................\...............................\.......\....\..........\........\WAVE_v.sdo

...............................\...............................\.......\....\..........\........\work\@c@y@c@l@o@n@e_@p@r@i@m_@d@f@f@e\verilog.asm

...............................\...............................\.......\....\..........\........\....\................................\_primary.dat

...............................\...............................\.......\....\..........\........\....\................................\_primary.vhd

...............................\...............................\.......\....\..........\........\....\.w@a@v@e\verilog.asm

...............................\...............................\.......\....\..........\........\....\........\_primary.dat

...............................\...............................\.......\....\..........\........\....\........\_primary.vhd

...............................\...............................\.......\....\..........\........\....\cyclone_and1\verilog.asm

...............................\...............................\.......\....\..........\........\....\............\_primary.dat

...............................\...............................\.......\....\..........\........\....\............\_primary.vhd

...............................\...............................\.......\....\..........\........\....\............6\verilog.asm

...............................\...............................\.......\....\..........\........\....\.............\_primary.dat

...............................\...............................\....

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