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文件名称:USB_CY7C68013_Verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [C/C++] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 195kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 王**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

利用verilog语言读写基于CY7C68013A的USB器件，使用，轻松上手。-Use language to read and write verilog CY7C68013A based USB device, use, easy to get started.
相关搜索： verilog
usb

(系统自动生成,下载前可以参看下载内容)

下载文件列表

USB_CY7C68013_Verilog\readme.txt

.....................\usb_wr_firmware\build.bat

.....................\...............\bulkloop

.....................\...............\bulkloop.c

.....................\...............\bulkloop.iic

.....................\...............\bulkloop.iic.bak

.....................\...............\bulkloop.lnp

.....................\...............\bulkloop.LST

.....................\...............\bulkloop.M51

.....................\...............\bulkloop.OBJ

.....................\...............\bulkloop.Opt

.....................\...............\bulkloop.plg

.....................\...............\bulkloop.__i

.....................\...............\bulkloop_Opt.Bak

.....................\...............\bulkloop_Uv2.Bak

.....................\...............\dscr.a51

.....................\...............\dscr.LST

.....................\...............\dscr.OBJ

.....................\...............\dscr._ia

.....................\...............\Ezusb.lib

.....................\...............\EZWin2K.INF

.....................\...............\firmware.c

.....................\...............\fw.c

.....................\...............\fw.LST

.....................\...............\fw.OBJ

.....................\...............\fw.__i

.....................\...............\Fx2.h

.....................\...............\fx2regs.h

.....................\...............\fx2regs.inc

.....................\...............\fx2sdly.h

.....................\...............\hex2c.exe

.....................\...............\readme.txt

.....................\...............\syncdly.h

.....................\...............\USBJmpTb.OBJ

.....................\...............\usb_wr_in

.....................\...............\usb_wr_in.hex

.....................\...............\usb_wr_in.lnp

.....................\...............\usb_wr_in.M51

.....................\...............\usb_wr_in.Opt

.....................\...............\usb_wr_in.plg

.....................\...............\usb_wr_in.Uv2

.....................\...............\usb_wr_in_Opt.Bak

.....................\...............\usb_wr_in_Uv2.Bak

.....................\.......Verilog\read me.txt

.....................\..............\transcript

.....................\..............\USB_wr.asm.rpt

.....................\..............\USB_wr.cdf

.....................\..............\USB_wr.done

.....................\..............\USB_wr.dpf

.....................\..............\USB_wr.fit.smsg

.....................\..............\USB_wr.fit.summary

.....................\..............\USB_wr.flow.rpt

.....................\..............\USB_wr.jdi

.....................\..............\USB_wr.map.rpt

.....................\..............\USB_wr.map.summary

.....................\..............\USB_wr.merge.rpt

.....................\..............\USB_wr.pin

.....................\..............\USB_wr.qpf

.....................\..............\USB_wr.qsf

.....................\..............\USB_wr.qws

.....................\..............\USB_wr.tan.summary

.....................\..............\USB_wr.v

.....................\..............\USB_wr.v.bak

.....................\usb_wr_firmware

.....................\usb_wr_Verilog

USB_CY7C68013_Verilog

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