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文件名称:Count-display-circuit-design(VHDL)

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 45kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • hhs***
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用VHDL语言设计计数显示电路。设计输出为3位BCD码的计数显示电路。由三个模块构成：十进制计数器（BCD_CNT）、分时总线切换电路（SCAN）和七段显示译码器电路（DEC_LED）-VHDL language to count the display circuit. The design output for display circuit 3 BCD count. Consists of three modules: the decimal counter (BCD_CNT), time division bus switching circuit (SCAN) and seven-segment display decoder circuit (DEC_LED)
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下载文件列表

Count display circuit design(VHDL).doc

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