文件名称:xapp1064
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Source-Synchronous Serialization and
Deserialization (up to 1050 Mb/s)
Deserialization (up to 1050 Mb/s)
(系统自动生成,下载前可以参看下载内容)
下载文件列表
XAPP1064\readme.txt
........\Verilog_Source
........\..............\Macros
........\..............\......\clock_generator_ddr_s8_diff.v
........\..............\......\clock_generator_pll_s16_diff.v
........\..............\......\clock_generator_pll_s8_diff.v
........\..............\......\clock_generator_sdr_s8_diff.v
........\..............\......\serdes_1_to_n_clk_ddr_s8_diff.v
........\..............\......\serdes_1_to_n_clk_ddr_s8_se.v
........\..............\......\serdes_1_to_n_clk_pll_s16_diff.v
........\..............\......\serdes_1_to_n_clk_pll_s8_diff.v
........\..............\......\serdes_1_to_n_clk_sdr_s8_diff.v
........\..............\......\serdes_1_to_n_data_ddr_s8_diff.v
........\..............\......\serdes_1_to_n_data_ddr_s8_se.v
........\..............\......\serdes_1_to_n_data_s8_diff.v
........\..............\......\serdes_n_to_1_ddr_s8_diff.v
........\..............\......\serdes_n_to_1_ddr_s8_se.v
........\..............\......\serdes_n_to_1_s16_diff.v
........\..............\......\serdes_n_to_1_s8_diff.v
........\..............\Top level examples
........\..............\..................\BUFIO2 DDR
........\..............\..................\..........\top_nto1_ddr_diff_rx.ucf
........\..............\..................\..........\top_nto1_ddr_diff_rx.v
........\..............\..................\..........\top_nto1_ddr_diff_tx.ucf
........\..............\..................\..........\top_nto1_ddr_diff_tx.v
........\..............\..................\..........\top_nto1_ddr_se_rx.ucf
........\..............\..................\..........\top_nto1_ddr_se_rx.v
........\..............\..................\..........\top_nto1_ddr_se_tx.ucf
........\..............\..................\..........\top_nto1_ddr_se_tx.v
........\..............\..................\PLL
........\..............\..................\...\top_nto1_pll_diff_rx.ucf
........\..............\..................\...\top_nto1_pll_diff_rx.v
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........\..............\..................\...\top_nto1_pll_diff_rx_and_tx.v
........\..............\..................\...\top_nto1_pll_diff_tx.ucf
........\..............\..................\...\top_nto1_pll_diff_tx.v
........\VHDL_Source
........\...........\Macros
........\...........\......\clock_generator_ddr_s8_diff.vhd
........\...........\......\clock_generator_pll_s16_diff.vhd
........\...........\......\clock_generator_pll_s8_diff.vhd
........\...........\......\clock_generator_sdr_s8_diff.vhd
........\...........\......\serdes_1_to_n_clk_ddr_s8_diff.vhd
........\...........\......\serdes_1_to_n_clk_ddr_s8_se.vhd
........\...........\......\serdes_1_to_n_clk_pll_s16_diff.vhd
........\...........\......\serdes_1_to_n_clk_pll_s8_diff.vhd
........\...........\......\serdes_1_to_n_clk_sdr_s8_diff.vhd
........\...........\......\serdes_1_to_n_data_ddr_s8_diff.vhd
........\...........\......\serdes_1_to_n_data_ddr_s8_se.vhd
........\...........\......\serdes_1_to_n_data_s8_diff.vhd
........\...........\......\serdes_n_to_1_ddr_s8_diff.vhd
........\...........\......\serdes_n_to_1_ddr_s8_se.vhd
........\...........\......\serdes_n_to_1_s16_diff.vhd
........\...........\......\serdes_n_to_1_s8_diff.vhd
........\...........\Top level examples
........\...........\..................\BUFIO2 DDR
........\...........\..................\..........\top_nto1_ddr_diff_rx.ucf
........\...........\..................\..........\top_nto1_ddr_diff_rx.vhd
........\...........\..................\..........\top_nto1_ddr_diff_tx.ucf
........\...........\..................\..........\top_nto1_ddr_diff_tx.vhd
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........\...........\..................\..........\top_nto1_ddr_se_rx.vhd
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........\...........\..................\..........\top_nto1_ddr_se_tx.vhd
........\...........\..................\PLL
........\...........\..................\...\top_nto1_pll_diff_rx.ucf
........\...........\..................\
........\Verilog_Source
........\..............\Macros
........\..............\......\clock_generator_ddr_s8_diff.v
........\..............\......\clock_generator_pll_s16_diff.v
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........\..............\Top level examples
........\..............\..................\BUFIO2 DDR
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........\VHDL_Source
........\...........\Macros
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........\...........\..................\