文件名称:My_DES3

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 841kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • Far***
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介绍说明--下载内容均来自于网络,请自行研究使用

a triple-DES (Data Encryption Standard) hardware descr iption in verilog-HDL with testbench
(系统自动生成,下载前可以参看下载内容)

下载文件列表

My_DES3

.......\des

.......\...\branches

.......\...\tags

.......\...\....\initial

.......\...\....\.......\README.txt

.......\...\trunk

.......\...\.....\bench

.......\...\.....\.....\verilog

.......\...\.....\.....\.......\des3_test_ao.v

.......\...\.....\.....\.......\des3_test_ao.v.bak

.......\...\.....\.....\.......\des3_test_po.v

.......\...\.....\.....\.......\des_test_ao.v

.......\...\.....\.....\.......\des_test_po.v

.......\...\.....\.....\.......\Test Bench For 3DES.v

.......\...\.....\.....\.......\transcript

.......\...\.....\.....\.......\TrippleDES.tcl

.......\...\.....\.....\.......\TrippleDES.tcl.bak

.......\...\.....\doc

.......\...\.....\...\README.txt

.......\...\.....\rtl

.......\...\.....\...\verilog

.......\...\.....\...\.......\area_opt

.......\...\.....\...\.......\........\des.v

.......\...\.....\...\.......\........\des3.v

.......\...\.....\...\.......\........\key_sel.v

.......\...\.....\...\.......\........\key_sel3.v

.......\...\.....\...\.......\common

.......\...\.....\...\.......\......\crp.v

.......\...\.....\...\.......\......\sbox1.v

.......\...\.....\...\.......\......\sbox2.v

.......\...\.....\...\.......\......\sbox3.v

.......\...\.....\...\.......\......\sbox4.v

.......\...\.....\...\.......\......\sbox5.v

.......\...\.....\...\.......\......\sbox6.v

.......\...\.....\...\.......\......\sbox7.v

.......\...\.....\...\.......\......\sbox8.v

.......\...\.....\...\.......\perf_opt

.......\...\.....\...\.......\........\des.v

.......\...\.....\...\.......\........\des3.v

.......\...\.....\...\.......\........\key_sel.v

.......\...\.....\sim

.......\...\.....\...\rtl_sim

.......\...\.....\...\.......\bin

.......\...\.....\...\.......\...\Makefile

.......\...\.....\syn

.......\...\.....\...\bin

.......\...\.....\...\...\comp_ao.dc

.......\...\.....\...\...\comp_ao3.dc

.......\...\.....\...\...\comp_po.dc

.......\...\.....\...\...\comp_po3.dc

.......\...\.....\...\...\design_spec_ao.dc

.......\...\.....\...\...\design_spec_ao3.dc

.......\...\.....\...\...\design_spec_po.dc

.......\...\.....\...\...\design_spec_po3.dc

.......\...\.....\...\...\lib_spec.dc

.......\...\.....\...\...\read_ao.dc

.......\...\.....\...\...\read_ao3.dc

.......\...\.....\...\...\read_po.dc

.......\...\.....\...\...\read_po3.dc

.......\...\web_uploads

.......\...\...........\index.shtml

.......\DES3

.......\....\3des.tcl

.......\....\3des.tcl.bak

.......\....\crp.v

.......\....\des.v

.......\....\des3.v

.......\....\key_sel.v

.......\....\key_sel3.v

.......\....\modelsim.ini

.......\....\sbox1.v

.......\....\sbox2.v

.......\....\sbox3.v

.......\....\sbox4.v

.......\....\sbox5.v

.......\....\sbox6.v

.......\....\sbox7.v

.......\....\sbox8.v

.......\....\test_3des.v

.......\....\test_3des.v.bak

.......\....\transcript

.......\....\vsim.wlf

.......\....\wave.do

.......\....\work

.......\....\....\crp

.......\....\....\...\verilog.asm

.......\....\....\...\_primary.dat

.......\....\....\...\_primary.vhd

.......\....\....\des3

.......\....\....\....\verilog.asm

.......\....\....\....\_primary.dat

.......\....\....\....\_primary.vhd

.......\....\....\key_sel3

.......\....\....\........\verilog.asm

.......\....\....\........\_primary.dat

.......\....\....\........\_primary.vhd

.......\....\....\my_test

.......\....\....\.......\verilog.asm

.......\....\....\.......\_primary.dat

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