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文件名称:DDS-VERILOG

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 佘*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

DDS的信号发生器verilog代码 可直接用于编程 已经测试-Verilog code of the DDS signal generator which can be used directly in the programming has been tested
(系统自动生成,下载前可以参看下载内容)

下载文件列表

DDS的VERILOG原代码.doc

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