文件名称:fp_prj
介绍说明－－下载内容均来自于网络，请自行研究使用
简单的Testbench设计，对FPGA初学者来说很好用-Simple Testbench design, the FPGA is fine for beginners
(系统自动生成,下载前可以参看下载内容)
下载文件列表
fp_prj\db\add_sub_vmh.tdf
......\..\fp_verilog.cbx.xml
......\..\fp_verilog.cmp.rdb
......\..\fp_verilog.db_info
......\..\fp_verilog.eco.cdb
......\..\fp_verilog.fnsim.cdb
......\..\fp_verilog.fnsim.hdb
......\..\fp_verilog.fnsim.qmsg
......\..\fp_verilog.hier_info
......\..\fp_verilog.hif
......\..\fp_verilog.lpc.html
......\..\fp_verilog.lpc.rdb
......\..\fp_verilog.lpc.txt
......\..\fp_verilog.map.cdb
......\..\fp_verilog.map.hdb
......\..\fp_verilog.map.logdb
......\..\fp_verilog.map.qmsg
......\..\fp_verilog.pre_map.cdb
......\..\fp_verilog.pre_map.hdb
......\..\fp_verilog.rtlv.hdb
......\..\fp_verilog.rtlv_sg.cdb
......\..\fp_verilog.rtlv_sg_swap.cdb
......\..\fp_verilog.sgdiff.cdb
......\..\fp_verilog.sgdiff.hdb
......\..\fp_verilog.sim.hdb
......\..\fp_verilog.sim.qmsg
......\..\fp_verilog.sld_design_entry.sci
......\..\fp_verilog.sld_design_entry_dsc.sci
......\..\fp_verilog.syn_hier_info
......\..\fp_verilog.tis_db_list.ddb
......\..\fp_verilog.tmw_info
......\..\logic_util_heursitic.dat
......\..\prev_cmp_fp_verilog.asm.qmsg
......\..\prev_cmp_fp_verilog.eda.qmsg
......\..\prev_cmp_fp_verilog.fit.qmsg
......\..\prev_cmp_fp_verilog.map.qmsg
......\..\prev_cmp_fp_verilog.qmsg
......\..\prev_cmp_fp_verilog.tan.qmsg
......\..\wed.wsf
......\fp_verilog.asm.rpt
......\fp_verilog.cdf
......\fp_verilog.done
......\fp_verilog.dpf
......\fp_verilog.eda.rpt
......\fp_verilog.fit.rpt
......\fp_verilog.fit.summary
......\fp_verilog.flow.rpt
......\fp_verilog.map.rpt
......\fp_verilog.map.summary
......\fp_verilog.pin
......\fp_verilog.pof
......\fp_verilog.qpf
......\fp_verilog.qsf
......\fp_verilog.qws
......\fp_verilog.tan.rpt
......\fp_verilog.tan.summary
......\fp_verilog.v
......\fp_verilog.vwf
......\fp_verilog_nativelink_simulation.rpt
......\incremental_db\compiled_partitions\fp_verilog.root_partition.map.kpt
......\..............\README
......\simulation\modelsim\fp_verilog.sft
......\..........\........\fp_verilog.vo
......\..........\........\fp_verilog.vt
......\..........\........\fp_verilog_modelsim.xrf
......\..........\........\fp_verilog_run_msim_rtl_verilog.do
......\..........\........\fp_verilog_v.sdo
......\..........\........\modelsim.ini
......\..........\........\msim_transcript
......\..........\........\rtl_work\fp_verilog\verilog.prw
......\..........\........\........\..........\verilog.psm
......\..........\........\........\..........\_primary.dat
......\..........\........\........\..........\_primary.dbs
......\..........\........\........\..........\_primary.vhd
......\..........\........\........\.........._vlg_tst\verilog.prw
......\..........\........\........\..................\verilog.psm
......\..........\........\........\..................\_primary.dat
......\..........\........\........\..................\_primary.dbs
......\..........\........\........\..................\_primary.vhd
......\..........\........\........\_info
......\..........\........\........\_vmake
......\..........\........\vsim.wlf
......\..........\........\rtl_work\fp_verilog
......\..........\........\........\fp_verilog_vlg_tst
......\..........\........\........\_temp
......\..........\........\rtl_work
......\incremental_db\compiled_partitions
......\simulation\modelsim
......\db
......\incremental_db
......\simulation
fp_prj
......\..\fp_verilog.cbx.xml
......\..\fp_verilog.cmp.rdb
......\..\fp_verilog.db_info
......\..\fp_verilog.eco.cdb
......\..\fp_verilog.fnsim.cdb
......\..\fp_verilog.fnsim.hdb
......\..\fp_verilog.fnsim.qmsg
......\..\fp_verilog.hier_info
......\..\fp_verilog.hif
......\..\fp_verilog.lpc.html
......\..\fp_verilog.lpc.rdb
......\..\fp_verilog.lpc.txt
......\..\fp_verilog.map.cdb
......\..\fp_verilog.map.hdb
......\..\fp_verilog.map.logdb
......\..\fp_verilog.map.qmsg
......\..\fp_verilog.pre_map.cdb
......\..\fp_verilog.pre_map.hdb
......\..\fp_verilog.rtlv.hdb
......\..\fp_verilog.rtlv_sg.cdb
......\..\fp_verilog.rtlv_sg_swap.cdb
......\..\fp_verilog.sgdiff.cdb
......\..\fp_verilog.sgdiff.hdb
......\..\fp_verilog.sim.hdb
......\..\fp_verilog.sim.qmsg
......\..\fp_verilog.sld_design_entry.sci
......\..\fp_verilog.sld_design_entry_dsc.sci
......\..\fp_verilog.syn_hier_info
......\..\fp_verilog.tis_db_list.ddb
......\..\fp_verilog.tmw_info
......\..\logic_util_heursitic.dat
......\..\prev_cmp_fp_verilog.asm.qmsg
......\..\prev_cmp_fp_verilog.eda.qmsg
......\..\prev_cmp_fp_verilog.fit.qmsg
......\..\prev_cmp_fp_verilog.map.qmsg
......\..\prev_cmp_fp_verilog.qmsg
......\..\prev_cmp_fp_verilog.tan.qmsg
......\..\wed.wsf
......\fp_verilog.asm.rpt
......\fp_verilog.cdf
......\fp_verilog.done
......\fp_verilog.dpf
......\fp_verilog.eda.rpt
......\fp_verilog.fit.rpt
......\fp_verilog.fit.summary
......\fp_verilog.flow.rpt
......\fp_verilog.map.rpt
......\fp_verilog.map.summary
......\fp_verilog.pin
......\fp_verilog.pof
......\fp_verilog.qpf
......\fp_verilog.qsf
......\fp_verilog.qws
......\fp_verilog.tan.rpt
......\fp_verilog.tan.summary
......\fp_verilog.v
......\fp_verilog.vwf
......\fp_verilog_nativelink_simulation.rpt
......\incremental_db\compiled_partitions\fp_verilog.root_partition.map.kpt
......\..............\README
......\simulation\modelsim\fp_verilog.sft
......\..........\........\fp_verilog.vo
......\..........\........\fp_verilog.vt
......\..........\........\fp_verilog_modelsim.xrf
......\..........\........\fp_verilog_run_msim_rtl_verilog.do
......\..........\........\fp_verilog_v.sdo
......\..........\........\modelsim.ini
......\..........\........\msim_transcript
......\..........\........\rtl_work\fp_verilog\verilog.prw
......\..........\........\........\..........\verilog.psm
......\..........\........\........\..........\_primary.dat
......\..........\........\........\..........\_primary.dbs
......\..........\........\........\..........\_primary.vhd
......\..........\........\........\.........._vlg_tst\verilog.prw
......\..........\........\........\..................\verilog.psm
......\..........\........\........\..................\_primary.dat
......\..........\........\........\..................\_primary.dbs
......\..........\........\........\..................\_primary.vhd
......\..........\........\........\_info
......\..........\........\........\_vmake
......\..........\........\vsim.wlf
......\..........\........\rtl_work\fp_verilog
......\..........\........\........\fp_verilog_vlg_tst
......\..........\........\........\_temp
......\..........\........\rtl_work
......\incremental_db\compiled_partitions
......\simulation\modelsim
......\db
......\incremental_db
......\simulation
fp_prj