文件名称:cnt10

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 202kb
  • 下载次数:
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介绍说明--下载内容均来自于网络,请自行研究使用

设计带有异步复位、同步计数使能和可预置型的十进制计数器。

具有5个输入端口(CLK、RST、EN、LOAD、DATA)。CLK输入时钟信号;RST起异步复位作用,RST=0,复位;EN是时钟使能,EN=1,允许加载或计数;LOAD是数据加载控制,LOAD=0,向内部寄存器加载数据;DATA是4位并行加载的数据。有两个输出端口(DOUT和COUT)。DOUT的位宽为4,输出计数值,从0到9;COUT是输出进位标志,位宽为1,每当DOUT为9时输出一个高电平脉冲

-Designed with an asynchronous reset, enable and synchronous count-based pre-decimal counter. With five input (CLK, RST, EN, LOAD, DATA). Input clock signal CLK RST play the role of an asynchronous reset, RST = 0, reset EN clock is enabled, EN = 1, to allow loading or count LOAD is the data load control, LOAD = 0, load data to the internal register  DATA is a 4-bit parallel loading of data. There are two output ports (DOUT and COUT). DOUT bit width is 4, the output count value from 0 to 9 COUT is the output carry flag, bit width is 1, when DOUT is a high level pulse output 9
(系统自动生成,下载前可以参看下载内容)

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cnt10\.sopc_builder\filters.xml

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.....\..\prev_cmp_CNT10.map.qmsg

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.....\..\prev_cmp_CNT10.tan.qmsg

.....\..\wed.wsf

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.....\..............\...................\CNT10.root_partition.map.kpt

.....\..............\README

.....\sopc_builder_log.txt

.....\incremental_db\compiled_partitions

.....\.sopc_builder

.....\db

.....\incremental_db

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