文件名称:counter

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 19kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 郭*
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

这是带清零端的8位二进制计数器,是用verilog hdl语言编写的-This is the side with a clear 8-bit binary counter, is written with the verilog hdl
(系统自动生成,下载前可以参看下载内容)

下载文件列表

counter\counter.cr.mti

.......\counter.mpf

.......\counter.v.bak

.......\counter_test.v

.......\counter_test.v.bak

.......\couter_8.v

.......\transcript

.......\vish_stacktrace.vstf

.......\vsim.wlf

.......\vsim.wlf.temp

.......\work\counter\verilog.asm

.......\....\.......\_primary.dat

.......\....\.......\_primary.vhd

.......\....\test\verilog.asm

.......\....\....\_primary.dat

.......\....\....\_primary.vhd

.......\....\_info

.......\....\counter

.......\....\test

.......\work

counter

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