文件名称:VHDLguoliangjiance

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 673kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • liu***
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过零检测,输出部分有整数部分和偏移部分组成-Zero-crossing detection, the output part of the integer part and offset a part
相关搜索: 过零

(系统自动生成,下载前可以参看下载内容)

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修改后的过零检测,输出数据有整数部分和偏移部分组成\ad_block.bsf

..................................................\ad_block.vhd

..................................................\clk_adminstrator.bsf

..................................................\clk_adminstrator.vhd

..................................................\clk_gen.bsf

..................................................\clk_gen.vhd

..................................................\command_contral.bsf

..................................................\command_contral.vhd

..................................................\dat10_2.hex

..................................................\.b\add_sub_34i.tdf

..................................................\..\add_sub_44i.tdf

..................................................\..\add_sub_b4i.tdf

..................................................\..\add_sub_j2i.tdf

..................................................\..\add_sub_k2i.tdf

..................................................\..\add_sub_l2i.tdf

..................................................\..\add_sub_m2i.tdf

..................................................\..\add_sub_q2i.tdf

..................................................\..\altsyncram_7tv.tdf

..................................................\..\altsyncram_8rv.tdf

..................................................\..\altsyncram_lsv.tdf

..................................................\..\dpl.asm.qmsg

..................................................\..\dpl.asm_labs.ddb

..................................................\..\dpl.cbx.xml

..................................................\..\dpl.cmp.cdb

..................................................\..\dpl.cmp.hdb

..................................................\..\dpl.cmp.logdb

..................................................\..\dpl.cmp.qrpt

..................................................\..\dpl.cmp.rdb

..................................................\..\dpl.cmp.tdb

..................................................\..\dpl.cmp0.ddb

..................................................\..\dpl.cmp2.ddb

..................................................\..\dpl.dbp

..................................................\..\dpl.db_info

..................................................\..\dpl.eco.cdb

..................................................\..\dpl.eds_overflow

..................................................\..\dpl.fit.qmsg

..................................................\..\dpl.fnsim.hdb

..................................................\..\dpl.fnsim.qmsg

..................................................\..\dpl.hier_info

..................................................\..\dpl.hif

..................................................\..\dpl.map.cdb

..................................................\..\dpl.map.hdb

..................................................\..\dpl.map.logdb

..................................................\..\dpl.map.qmsg

..................................................\..\dpl.pre_map.cdb

..................................................\..\dpl.pre_map.hdb

..................................................\..\dpl.psp

..................................................\..\dpl.rtlv.hdb

..................................................\..\dpl.rtlv_sg.cdb

..................................................\..\dpl.rtlv_sg_swap.cdb

..................................................\..\dpl.sgdiff.cdb

..................................................\..\dpl.sgdiff.hdb

..................................................\..\dpl.signalprobe.cdb

..................................................\..\dpl.sim.qmsg

..................................................\..\dpl.sim.qrpt

..................................................\..\dpl.sim.rdb

..................................................\..\dpl.sim.vwf

..................................................\..\dpl.sld_design_entry.sci

..................................................\..\dpl.sld_design_entry_dsc.sci

..................................................\..\dpl

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