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文件名称:counter

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 2kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 王*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

关于FPGA实现的几种计数器的verilog源程序-FPGA implementation of several counter verilog source code
相关搜索： FPGA
counter

(系统自动生成,下载前可以参看下载内容)

下载文件列表

Verilog源码\10进制减法计数器.txt

...........\24进制计数器.txt

...........\8位约翰计数器.txt

...........\8进制计数器.txt

...........\可预置可循环的加减计数器.txt

Verilog源码

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