文件名称:my_reg
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D触发器，Verilog实现，配有实验说明文档。-D flip-flop, Verilog implementation, with experimental documentation.
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下载文件列表
D触发器实验例程及文档
.....................\D触发器.pdf
.....................\my_reg
.....................\......\component
.....................\......\constraint
.....................\......\coreconsole
.....................\......\designer
.....................\......\........\impl1
.....................\......\........\.....\designer.log
.....................\......\........\.....\my_reg.adb
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.....................\......\........\.....\simulation
.....................\......\hdl
.....................\......\...\clk_div.v
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.....................\......\stimulus
.....................\......\synthesis
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.....................\......\.........\run_options.txt
.....................\......\.........\stdout.log
.....................\......\.........\syntmp
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.....................\......\.........\traplog.tlg
.....................\......\viewdraw
.....................\......\........\sch
.....................\......\........\sym
.....................\......\........\vf
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.....................\......\........\wir
.....................\D触发器.pdf
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