文件名称:top_ram

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 3.6mb
  • 下载次数:
  • 0次
  • 提 供 者:
  • z**
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

在quartus环境下调用ram核并对其进行功能时序仿真-ram
(系统自动生成,下载前可以参看下载内容)

下载文件列表

top_ram\db\altsyncram_l0a1.tdf

.......\..\prev_cmp_top_ram.asm.qmsg

.......\..\prev_cmp_top_ram.eda.qmsg

.......\..\prev_cmp_top_ram.fit.qmsg

.......\..\prev_cmp_top_ram.map.qmsg

.......\..\prev_cmp_top_ram.qmsg

.......\..\prev_cmp_top_ram.tan.qmsg

.......\..\top_ram.asm.qmsg

.......\..\top_ram.asm_labs.ddb

.......\..\top_ram.cbx.xml

.......\..\top_ram.cmp.bpm

.......\..\top_ram.cmp.cdb

.......\..\top_ram.cmp.ecobp

.......\..\top_ram.cmp.hdb

.......\..\top_ram.cmp.logdb

.......\..\top_ram.cmp.rdb

.......\..\top_ram.cmp.tdb

.......\..\top_ram.cmp0.ddb

.......\..\top_ram.db_info

.......\..\top_ram.eco.cdb

.......\..\top_ram.eda.qmsg

.......\..\top_ram.fit.qmsg

.......\..\top_ram.hier_info

.......\..\top_ram.hif

.......\..\top_ram.map.bpm

.......\..\top_ram.map.cdb

.......\..\top_ram.map.ecobp

.......\..\top_ram.map.hdb

.......\..\top_ram.map.logdb

.......\..\top_ram.map.qmsg

.......\..\top_ram.map_bb.cdb

.......\..\top_ram.map_bb.hdb

.......\..\top_ram.map_bb.hdbx

.......\..\top_ram.map_bb.logdb

.......\..\top_ram.pre_map.cdb

.......\..\top_ram.pre_map.hdb

.......\..\top_ram.psp

.......\..\top_ram.root_partition.cmp.atm

.......\..\top_ram.root_partition.cmp.dfp

.......\..\top_ram.root_partition.cmp.hdbx

.......\..\top_ram.root_partition.cmp.logdb

.......\..\top_ram.root_partition.cmp.rcf

.......\..\top_ram.root_partition.map.atm

.......\..\top_ram.root_partition.map.hdbx

.......\..\top_ram.root_partition.map.info

.......\..\top_ram.rtlv.hdb

.......\..\top_ram.rtlv_sg.cdb

.......\..\top_ram.rtlv_sg_swap.cdb

.......\..\top_ram.sgdiff.cdb

.......\..\top_ram.sgdiff.hdb

.......\..\top_ram.signalprobe.cdb

.......\..\top_ram.sld_design_entry.sci

.......\..\top_ram.sld_design_entry_dsc.sci

.......\..\top_ram.syn_hier_info

.......\..\top_ram.tan.qmsg

.......\..\top_ram.tis_db_list.ddb

.......\..\top_ram.tmw_info

.......\ram.bsf

.......\ram.qip

.......\ram.v

.......\ram_bb.v

.......\ram_inst.v

.......\ram_syn.v

.......\ram_wave0.jpg

.......\ram_wave1.jpg

.......\ram_waveforms.html

.......\simulation\modelsim\msim_transcript

.......\..........\........\top_ram.cr.mti

.......\..........\........\top_ram.mpf

.......\..........\........\top_ram.sft

.......\..........\........\top_ram.vo

.......\..........\........\top_ram.vt

.......\..........\........\top_ram.vt.bak

.......\..........\........\top_ram_modelsim.xrf

.......\..........\........\top_ram_run_msim_gate_verilog.do

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak1

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak2

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak3

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak4

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak5

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak6

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak7

.......\..........\........\top_ram_run_msim_gate_verilog.do.bak8

.......\..........\........\top_ram_run_msim_rtl_verilog.do

.......\..........\........\top_ram_v.sdo

.......\..........\........\verilog_libs\cycloneii_ver\@a@l@t@e@r@a_@d@e@v@i@c@e_@f@a@m@i@l@i@e@s\verilog.asm

.......\..........\........\............\.............\..........................................\_primary.dat

.......\..........\........\............\.............\..........................................\_primary.vhd

.......\..........\........\............\.............\..............m@f_@h@i@n@t_@e@v@a@l@u@a@t@i@o@n\verilog.asm

.......\..........\........\............\.............\...............................................\_primary.dat

.......\..........\........\............\.............\...............................................\_primary.vhd

.......\..........\........\............\.............\...................m@e@m@o@r@y_@i@n@i@t@i@a@l@i@z@a@t@i@o@n\verilog.asm

.......\..........\........\............\.............\...........................................................\_primary.dat

.......\..........\........\............\.............\..........

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