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文件名称:SPconversion_CPLD_FPGA_VHDL

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • mag***
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

基于状态机的8bit并串变换，使用VHDL语言，使用Xilinx ISE，程序特点是使用了状态机，通过分析可以学习如何使用状态机编程，并完成8bit并串变换的功能-8bit based on state machines and string transformation, using VHDL language, using the Xilinx ISE, process characterized by the use of the state machine, the analysis can learn how to use the state machine programming, and complete the 8bit and string transformation functions
相关搜索： 并串
VHDL

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串并变换.txt

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