文件名称:VHDL1
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4位并行加法器,a3,a2,a1,a0,b3,b2,b1,b0,cin为输入,cout,s3,s2,s1,s0为输出-4-bit parallel adder, a3, a2, a1, a0, b3, b2, b1, b0, cin as the input, cout, s3, s2, s1, s0 as the output
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f_adder.vhd
VHDL1.vhd
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