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文件名称:delay_early_gate

  • 所属分类：
  • 其他小程序
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 5kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 白*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

全数字超前—滞后门符号同步算法的FPGA实现的verilog源代码-digital lead-lag syn
(系统自动生成,下载前可以参看下载内容)

下载文件列表

eddds.xco

iir1.v

iir.v

de_mult.xco

dearly_sub.v

dedds.v

delay_early_gate.v

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