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文件名称:bitsyn

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 64kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 龙*
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

在ＦＰＧＡ设计中，当接收的数据需要用数据中提取时钟的时候，需要进行同步处理，该文章详细介绍了数据同步处理的过程-In the FPGA design, when the received data need to extract the clock when the data needs to be synchronized, the article introduced in detail the process of data synchronization processing
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