文件名称:dual_RAM
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vhdl语言编写的双口ram及testbench,模块可以在modelsim里进行时序和功能仿真。-vhdl language of the dual-port ram, and testbench, modules, conducted in the modelsim timing and functional simulation.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
dualaram_tb.vhd
dualaram.vhd
dualaram.vhd