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文件名称:watchdog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 4kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 郑**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

看门狗定时器Verilog源码；用于MCU的辅助模块，定时特定的时间来做硬件复位，是用于避免固件跑死的一个机制。-Watchdog verilog source.
相关搜索： watchdog
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verilog
vhdl
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verilog
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watchdog
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watchdog
vhdl

(系统自动生成,下载前可以参看下载内容)

下载文件列表

watchdog\CVS\Root

........\...\Repository

........\...\Entries

........\rtl\CVS\Root

........\...\...\Repository

........\...\...\Entries

........\...\verilog\CVS\Root

........\...\.......\...\Repository

........\...\.......\...\Entries

........\...\.......\timescale.v

........\...\.......\watchdog.v

........\...\.......\watchdog_defines.v

........\...\.......\CVS

........\...\CVS

........\...\verilog

........\CVS

........\rtl

watchdog

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