文件名称:Seg7_dsp
介绍说明－－下载内容均来自于网络，请自行研究使用
带有FPGA的pll模块的数字钟，带有仿真文件。-With the FPGA module pll digital clock with a simulation file.
(系统自动生成,下载前可以参看下载内容)
下载文件列表
Seg7_dsp
........\cmp_state.ini
........\code.vhd
........\code.vhd.bak
........\COUNTER24.VHD
........\COUNTER60.VHD
........\db
........\..\prev_cmp_Seg7_dsp.asm.qmsg
........\..\prev_cmp_Seg7_dsp.fit.qmsg
........\..\prev_cmp_Seg7_dsp.map.qmsg
........\..\prev_cmp_Seg7_dsp.qmsg
........\..\prev_cmp_Seg7_dsp.sim.qmsg
........\..\prev_cmp_Seg7_dsp.tan.qmsg
........\..\Seg7_dsp.asm.qmsg
........\..\Seg7_dsp.asm_labs.ddb
........\..\Seg7_dsp.cbx.xml
........\..\Seg7_dsp.cmp.cdb
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........\..\Seg7_dsp.cmp.rdb
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........\..\Seg7_dsp.dbp
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........\..\Seg7_dsp.eds_overflow
........\..\Seg7_dsp.fit.qmsg
........\..\Seg7_dsp.hier_info
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........\..\Seg7_dsp.map.logdb
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........\..\Seg7_dsp.pre_map.hdb
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........\..\Seg7_dsp.pss
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........\..\Seg7_dsp.sgate_sm.rvd
........\..\Seg7_dsp.sgdiff.cdb
........\..\Seg7_dsp.sgdiff.hdb
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........\..\Seg7_dsp.sim.hdb
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........\..\Seg7_dsp.sim.rdb
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........\..\Seg7_dsp.sld_design_entry_dsc.sci
........\..\Seg7_dsp.syn_hier_info
........\..\Seg7_dsp.tan.qmsg
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........\seg_code.vhd.bak
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........\COUNTER60.VHD
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