文件名称:studyFFTcore

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [Matlab] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 1.23mb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 徐**
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  • 下载说明:
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介绍说明--下载内容均来自于网络,请自行研究使用

调用FPGA的IP核实现FFT运算,在xilinx的vertex4sx55FPGA的实现-Call FPGA implementation of the IP core FFT computation, in the Xilinx implementation of the vertex4sx55FPGA
(系统自动生成,下载前可以参看下载内容)

下载文件列表

study_FFTcore

.............\.lso

.............\core_fft64.asy

.............\core_fft64.ngc

.............\core_fft64.sym

.............\core_fft64.v

.............\core_fft64.veo

.............\core_fft64.vhd

.............\core_fft64.vho

.............\core_fft64.xco

.............\core_fft64_flist.txt

.............\core_fft64_readme.txt

.............\core_fft64_xfft_v4_1_xst_1.lso

.............\core_fft64_xfft_v4_1_xst_1_vhdl.prj

.............\core_fft64_xmdf.tcl

.............\fft64.asy

.............\fft64.ngc

.............\fft64.sym

.............\fft64.v

.............\fft64.veo

.............\fft64.vhd

.............\fft64.vho

.............\fft64.xco

.............\fft64_flist.txt

.............\fft64_readme.txt

.............\fft64_tbw.v

.............\fft64_tbw_v.fdo

.............\fft64_tbw_v.udo

.............\fft64_xfft_v4_1_xst_1.lso

.............\fft64_xfft_v4_1_xst_1_vhdl.prj

.............\fft64_xmdf.tcl

.............\fft_fun.cmd_log

.............\fft_fun.lso

.............\fft_fun.prj

.............\fft_fun.stx

.............\fft_fun.syr

.............\fft_fun.udo

.............\fft_fun.v

.............\fft_fun.xst

.............\fft_fun_summary.html

.............\fft_fun_tbw.v

.............\fft_fun_tbw_v.udo

.............\fft_im.dat

.............\fft_output_im.dat

.............\fft_output_re.dat

.............\fft_re.dat

.............\matlab

.............\......\fft_im.dat

.............\......\fft_re.dat

.............\......\main.asv

.............\......\main.m

.............\study_FFTcore.ise

.............\study_FFTcore.ise_ISE_Backup

.............\study_FFTcore.restore

.............\templates

.............\.........\coregen.xml

.............\tmp

.............\...\_cg

.............\transcript

.............\work

.............\....\fft64

.............\....\.....\verilog.asm

.............\....\.....\_primary.dat

.............\....\.....\_primary.vhd

.............\....\fft64_tbw_v

.............\....\...........\verilog.asm

.............\....\...........\_primary.dat

.............\....\...........\_primary.vhd

.............\....\fft_fun

.............\....\.......\verilog.asm

.............\....\.......\_primary.dat

.............\....\.......\_primary.vhd

.............\....\fft_fun_tbw_v

.............\....\.............\verilog.asm

.............\....\.............\_primary.dat

.............\....\.............\_primary.vhd

.............\....\glbl

.............\....\....\verilog.asm

.............\....\....\_primary.dat

.............\....\....\_primary.vhd

.............\....\_info

.............\xfft_v4_1_timing_calculator_core_fft64.vhd

.............\xfft_v4_1_timing_calculator_fft64.vhd

.............\xst

.............\...\projnav.tmp

.............\...\work

.............\...\....\hdllib.ref

.............\...\....\vlg6A

.............\...\....\.....\fft64.bin

.............\...\....\vlg78

.............\...\....\.....\fft__fun.bin

.............\_xmsgs

.............\......\xst.xmsgs

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