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文件名称:clock_verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 曹*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog语言实现的数字钟，各种定时闹钟功能类似真实的表~利用EDA实验平台实现-Verilog language implementation of the digital clock, alarm clock features a variety of regular table similar to the real experimental platform ~ using EDA implementation ~ ~
相关搜索： alarm
verilog
闹钟
Verilog
定时
数字钟
verilog

(系统自动生成,下载前可以参看下载内容)

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clock_verilog.txt

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