文件名称:vga_core(vhdl)
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vga视频输出（vhdl），主要是从sdram中产生图形，输出到vga中-vga video outputs [vhdl], mainly arising from the SDRAM graphics, output to vga Medium
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下载文件列表
Readme.txt
vga_vhdl_code
.............\ASCII2VGA
.............\.........\afficheur_7segments.vhd
.............\.........\afficheur_vga.vhdl
.............\.........\constraint.ucf
.............\.........\screen_memory.vhd
.............\.........\symbols_table.vhd
.............\.........\top.vhdl
.............\SDRAM_VGA_GEN
.............\.............\an-101204-vgagen
.............\.............\................\common.vhd
.............\.............\................\sdramcntl.vhd
.............\.............\................\vga-timing.xls
.............\.............\................\vga.vhd
.............\.............\................\xsasdramcntl.vhd
.............\vga
.............\...\vgatst
.............\...\......\LIB
.............\...\......\...\VGATST.BLK
.............\...\......\...\VGATST.DIR
.............\...\......\...\VGATST.FIG
.............\...\......\...\VGATST.FLG
.............\...\......\...\VGATST.GNR
.............\...\......\...\VGATST.HDR
.............\...\......\...\VGATST.ID
.............\...\......\...\VGATST.INI
.............\...\......\...\VGATST.MAP
.............\...\......\...\VGATST.MOD
.............\...\......\...\VGATST.PIN
.............\...\......\...\VGATST.SYM
.............\...\......\...\VGATST.SYN
.............\...\......\...\VGATST.VIS
.............\...\......\logiblox.ini
.............\...\......\vgacore.abl
.............\...\......\vgacore.bak
.............\...\......\vgatst.bit
.............\...\......\vgatst.prj
.............\...\......\vgatst.ucf
.............\...\......\vgatst1.SCH
.............\...\......\vgatst40.ucf
.............\...\......\vgatst95.ucf
.............\...\VGATST.PDF
.............\...\vgavhdl
.............\...\.......\express
.............\...\.......\.......\chips
.............\...\.......\.......\.....\vgacore
.............\...\.......\.......\.....\.......\vgacore.cst
.............\...\.......\.......\.....\.......\vgacore.rpt
.............\...\.......\.......\.....\.......\vgacore.trt
.............\...\.......\.......\.....\.......\vgacore.ws
.............\...\.......\.......\.....\vgacore-Optimized
.............\...\.......\.......\.....\.................\vgacore-Optimized.cst
.............\...\.......\.......\.....\.................\vgacore-Optimized.rpt
.............\...\.......\.......\.....\.................\vgacore-Optimized.trt
.............\...\.......\.......\.....\.................\vgacore-Optimized.ws
.............\...\.......\.......\express.exp
.............\...\.......\.......\files
.............\...\.......\.......\.....\L1.rpt
.............\...\.......\.......\workdirs
.............\...\.......\.......\........\WORK
.............\...\.......\.......\........\....\Anal.info
.............\...\.......\.......\........\....\Anal.out
.............\...\.......\.......\........\....\vgacore.hnl
.............\...\.......\.......\........\....\VGACORE.mra
.............\...\.......\.......\........\....\vgacore.out
.............\...\.......\.......\........\....\VGACORE.sim
.............\...\.......\.......\........\....\vgacore.sts
.............\...\.......\.......\........\....\VGACORE.syn
.............\...\.......\.......\........\....\VGACORE__VGACORE_ARCH.sim
.............\...\.......\.......\........\....\VGACORE__VGACORE_ARCH.syn
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.............\...\.......\...\VGAVHDL.BLK
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.............\...\.......\...\VGAVHDL.SYN
.............\...\.......\...\VGAVHDL.VIS
.............\...\.......\logiblox.ini
.............\...\.......\vgacore.bak
.............\...\.......\vgacore.vhd
.............\...\.......\vgacore.xnf
.............\...\.......\vgatst40.ucf
.............\...\......
vga_vhdl_code
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