文件名称:decode

  • 所属分类:
  • 编译器/词法分析
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 2kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • att***
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介绍说明--下载内容均来自于网络,请自行研究使用

//接收端的解码模块(可综合)

//在信号接收的刚开始发送端发送的是10个1信号,

//即10个+M序列,所以我们在开始时每接收到一个信号做一次累加运算

//当出现正的高峰时则认为达到同步,进入同步解调过程(mainbody)。

//也就是从此每进入一个信号就进行相应的相乘相加,

//在解接收到31个信号后进行一次判断,大于0认为接收到1,小于0认为接收到0。-//Receiver decoder module (which can be integrated)// at the beginning of the signal received by the sending end to send a signal 10,// that is, 10+ M sequence, so we at the beginning of each receive a signal for a cumulative computing// When the peak is reached when that synchronization, access to the process of synchronous demodulation (mainbody).// That is, a signal from each corresponding to the sum of the multiplication,// in the solution of 31 receive a signal after the judge, that the receiver is greater than 0 to 1, less than 0 that received 0.
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decode.v

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