文件名称:rsic
- 所属分类：
- 单片机(51,AVR,MSP430等)
- 资源属性：
- [VHDL] [源码]
- 上传时间：
- 2012-11-26
- 文件大小：
- 327kb
- 下载次数：
- 0次
- 提 供 者：
- 陆**
- 相关连接：
- 无
- 下载说明：
- 别用迅雷下载，失败请重下，重下不扣分！
介绍说明－－下载内容均来自于网络，请自行研究使用
这是我同学在上海交大实习的时候做的一个单片机的verilog代码实现，希望对大家有帮助-This is my internship students of National Chiao Tung University in Shanghai to do when a single chip verilog code, and they hope to help you
(系统自动生成,下载前可以参看下载内容)
下载文件列表
rsic
....\Control_Unit.v
....\db
....\..\altsyncram_1n81.tdf
....\..\altsyncram_uq91.tdf
....\..\rsic.asm.qmsg
....\..\rsic.asm_labs.ddb
....\..\rsic.cbx.xml
....\..\rsic.cmp.cdb
....\..\rsic.cmp.hdb
....\..\rsic.cmp.logdb
....\..\rsic.cmp.qrpt
....\..\rsic.cmp.rdb
....\..\rsic.cmp.tdb
....\..\rsic.cmp0.ddb
....\..\rsic.cmp2.ddb
....\..\rsic.dbp
....\..\rsic.db_info
....\..\rsic.eco.cdb
....\..\rsic.fit.qmsg
....\..\rsic.hier_info
....\..\rsic.hif
....\..\rsic.map.cdb
....\..\rsic.map.hdb
....\..\rsic.map.logdb
....\..\rsic.map.qmsg
....\..\rsic.pre_map.cdb
....\..\rsic.pre_map.hdb
....\..\rsic.psp
....\..\rsic.rtlv.hdb
....\..\rsic.rtlv_sg.cdb
....\..\rsic.rtlv_sg_swap.cdb
....\..\rsic.sgdiff.cdb
....\..\rsic.sgdiff.hdb
....\..\rsic.signalprobe.cdb
....\..\rsic.sld_design_entry.sci
....\..\rsic.sld_design_entry_dsc.sci
....\..\rsic.smp_dump.txt
....\..\rsic.syn_hier_info
....\..\rsic.tan.qmsg
....\Memory_Unit.v
....\Processing_Unit.v
....\RISC_SPM.v
....\rsic.asm.rpt
....\rsic.done
....\rsic.fit.eqn
....\rsic.fit.rpt
....\rsic.fit.summary
....\rsic.flow.rpt
....\rsic.map.eqn
....\rsic.map.rpt
....\rsic.map.summary
....\rsic.pin
....\rsic.pof
....\rsic.qpf
....\rsic.qsf
....\rsic.qws
....\rsic.sof
....\rsic.tan.rpt
....\Control_Unit.v
....\db
....\..\altsyncram_1n81.tdf
....\..\altsyncram_uq91.tdf
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....\..\rsic.asm_labs.ddb
....\..\rsic.cbx.xml
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....\..\rsic.sld_design_entry_dsc.sci
....\..\rsic.smp_dump.txt
....\..\rsic.syn_hier_info
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....\Memory_Unit.v
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