文件名称:FPGA

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [PPT]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 5.13mb
  • 下载次数:
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FPGA培训教程,非常详细,适合初学者学习,EDA系列-FPGA training course, very detailed, suitable for beginners to learn, EDA Series
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FPGA课程培训

............\第1章课件

............\.........\1.1可编程逻辑器件概述.ppt

............\.........\1.2 FPGA的设计方法与要求.ppt

............\.........\1.3 FPGA的设计流程.ppt

............\.........\1.3.5 嵌入微处理器的FPGA设计流程.ppt

............\.........\1.4 FPGA的设计工具.ppt

............\.........\本章小结(第1章).ppt

............\第3章课件

............\.........\3.1 基于ISE5.2的输入方法.ppt

............\.........\3.1.2 HDL语言输入.ppt

............\.........\3.1.3 状态图输入.ppt

............\.........\3.1.4 IP复用.ppt

............\.........\3.2 基于Quartus的设计输入方法.ppt

............\.........\本章小结(第3章).ppt

............\.........\第3章 设计输入 .ppt

............\第4章课件

............\.........\4.1 基于Modelsim的功能仿真.ppt

............\.........\4.2 基于Quartus的仿真.ppt

............\.........\本章小结(第4章).ppt

............\第5章课件

............\.........\5.1 综合.ppt

............\.........\5.1.2 使用XST综合设计.ppt

............\.........\5.2 实行.ppt

............\.........\5.3 下载配置.ppt

............\.........\5.4 基于Quartus的编译与器件编程.ppt

............\.........\Thumbs.db

............\.........\本章小结(第5章).ppt

............\第7章课件

............\.........\7.1VHDL编程风格修改稿.ppt

............\.........\7.2层次设计修改稿.ppt

............\.........\7.3 Block RAM设计修改稿.ppt

............\.........\7.4 基于IP Core的Block RAM设计修改稿.ppt

............\.........\7.5 时钟设计修改稿.ppt

............\.........\本章小结.ppt

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