文件名称:firfilter_da

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 1.95mb
  • 下载次数:
  • 0次
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介绍说明--下载内容均来自于网络,请自行研究使用

分布式算法在实现乘加功能时,是通过将各输入数据的每一对应位产生的部分积预先进行相加形成相应的部分积,然后再对各个部分积累加形成最终结果的,而传统算法是等到所有乘积已经产生之后再来相加完成乘加运算的。与传统串行算法相比,分布式算法可极大地减少硬件电路的规模,提高电路的执行速度。

实现一个FIR滤波器,基于分布式算法

输入数据宽度:8位

输出数据宽度:16位

阶数:16阶

滤波器经转换后(右移16位)的特征参数为:

h[0]=h[15]=0000

h[1]=h[14]=0065

h[2]=h[13]=018F

h[3]=h[12]=035A

h[4]=h[11]=0579

h[5]=h[10]=078E

h[6]=h[9]=0935

h[7]=h[8]=0A1F

-err
(系统自动生成,下载前可以参看下载内容)

下载文件列表

firfilter_da

............\db

............\..\firfilter_da.asm.qmsg

............\..\firfilter_da.asm_labs.ddb

............\..\firfilter_da.cbx.xml

............\..\firfilter_da.cmp.bpm

............\..\firfilter_da.cmp.cdb

............\..\firfilter_da.cmp.ecobp

............\..\firfilter_da.cmp.hdb

............\..\firfilter_da.cmp.logdb

............\..\firfilter_da.cmp.rdb

............\..\firfilter_da.cmp.tdb

............\..\firfilter_da.cmp0.ddb

............\..\firfilter_da.cmp_bb.cdb

............\..\firfilter_da.cmp_bb.hdb

............\..\firfilter_da.cmp_bb.logdb

............\..\firfilter_da.cmp_bb.rcf

............\..\firfilter_da.dbp

............\..\firfilter_da.db_info

............\..\firfilter_da.eco.cdb

............\..\firfilter_da.eds_overflow

............\..\firfilter_da.fit.qmsg

............\..\firfilter_da.hier_info

............\..\firfilter_da.hif

............\..\firfilter_da.map.bpm

............\..\firfilter_da.map.cdb

............\..\firfilter_da.map.ecobp

............\..\firfilter_da.map.hdb

............\..\firfilter_da.map.logdb

............\..\firfilter_da.map.qmsg

............\..\firfilter_da.map_bb.cdb

............\..\firfilter_da.map_bb.hdb

............\..\firfilter_da.map_bb.logdb

............\..\firfilter_da.pre_map.cdb

............\..\firfilter_da.pre_map.hdb

............\..\firfilter_da.psp

............\..\firfilter_da.pss

............\..\firfilter_da.rtlv.hdb

............\..\firfilter_da.rtlv_sg.cdb

............\..\firfilter_da.rtlv_sg_swap.cdb

............\..\firfilter_da.sgdiff.cdb

............\..\firfilter_da.sgdiff.hdb

............\..\firfilter_da.signalprobe.cdb

............\..\firfilter_da.sim.cvwf

............\..\firfilter_da.sim.hdb

............\..\firfilter_da.sim.qmsg

............\..\firfilter_da.sim.rdb

............\..\firfilter_da.sld_design_entry.sci

............\..\firfilter_da.sld_design_entry_dsc.sci

............\..\firfilter_da.syn_hier_info

............\..\firfilter_da.tan.qmsg

............\..\prev_cmp_firfilter_da.asm.qmsg

............\..\prev_cmp_firfilter_da.fit.qmsg

............\..\prev_cmp_firfilter_da.map.qmsg

............\..\prev_cmp_firfilter_da.tan.qmsg

............\..\wed.wsf

............\firfilter_da.asm.rpt

............\firfilter_da.done

............\firfilter_da.fit.rpt

............\firfilter_da.fit.smsg

............\firfilter_da.fit.summary

............\firfilter_da.flow.rpt

............\firfilter_da.map.rpt

............\firfilter_da.map.smsg

............\firfilter_da.map.summary

............\firfilter_da.pin

............\firfilter_da.pof

............\firfilter_da.qpf

............\firfilter_da.qsf

............\firfilter_da.qws

............\firfilter_da.sim.rpt

............\firfilter_da.sof

............\firfilter_da.tan.rpt

............\firfilter_da.tan.summary

............\firfilter_da.v

............\firfilter_da.v.bak

............\firfilter_da.vwf

............\fir_in.salt

............\fir_out.txt

............\modelsim.ini

............\prev_cmp_firfilter_da.qmsg

............\tb_fir.v

............\tb_fir.v.bak

............\vsim.wlf

............\work

............\....\firfilter_da

............\....\............\verilog.asm

............\....\............\_primary.dat

............\....\............\_primary.vhd

............\....\tb_fir

............\....\......\verilog.asm

............\....\......\_primary.dat

............\....\......\_primary.vhd

............\....\_info

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