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文件名称:szzsybk

  • 所属分类：
  • 文档资料
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 277kb
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vhdl设计的简易数字钟，里面有报告的模板，设计思想，设计图，模块代码，简单易懂。-VHDL design of a simple digital clock, there are report templates, design ideas, design, module code, easy-to-read.
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