文件名称:uartsourcecode
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uart的FPGA模块,基于VHDL、verilog语言-the FPGA UART modules, based on VHDL, verilog language
(系统自动生成,下载前可以参看下载内容)
下载文件列表
uart 源码
.........\UART 源码 (lattice version).rar
.........\uart 源码 (Verilog).zip
.........\uart 源码 (VHDL).zip
.........\uart16550.tar.gz
.........\UART 源码 (lattice version).rar
.........\uart 源码 (Verilog).zip
.........\uart 源码 (VHDL).zip
.........\uart16550.tar.gz