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文件名称:add_3p

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 2kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • w**
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  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

3级流水线，含4元件的22位全加器的VHDL语言实现，适用于altera系列的FPGA-3-stage pipeline, with 4 components of 22 full adder realize the VHDL language, applicable to altera Series FPGA
相关搜索： 流水线
Altera
vhdl
pipeline
vhdl
fetch
stage

(系统自动生成,下载前可以参看下载内容)

下载文件列表

add_3p.vhd

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