文件名称:time_run

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 4kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 申*
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verilog描述

年月日,小时分秒的显示,2000~2099年的万历年循环

用set控制,设置状态,按一下改变一个设置,正常显示时,按set进入小时设置,依次是分钟,年,月,天(天设置带懂周变换)

在设置状态,按一下ADJ,加一下,按cf就减1,同步修改显示;设置状态下,按mode键或是60秒无按键,推出设置状态,返回正常显示

正常显示是,按ADJ,进行24,12小时显示切换,带AM_PM显示-Verilog descr iption of date, hours minutes and seconds display, from 2000 to 2099 million in the calendar year cycle with set control, set the status, click to change a setting, the normal display, press set to enter the hour set, followed by minute, year, month , days (days of week settings to understand transformation zone) in the set status, click the ADJ, plus some, by cf on by 1, modify the display simultaneously settings, press mode button or no button for 60 seconds, set to launch a state, return normal display is the normal display, press ADJ, switch to 24,12-hour show, with shows AM_PM
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calendar

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