文件名称:clkconv
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一种方便的全数字时钟频率转换电路设计，不使用PLL，转换档位多，资源占用少。-A convenient all-digital clock frequency conversion circuit design, do not use PLL, stall converter, and its resources are less occupied.
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clk2mtonk_rtl.vhd
clknkto2m_rtl.vhd
Timing_struct.vhd
clknkto2m_rtl.vhd
Timing_struct.vhd