文件名称:PWM

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2012-11-26
  • 文件大小:
  • 4.78mb
  • 下载次数:
  • 1次
  • 提 供 者:
  • z***
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

Core_PWM,verilog语言编写,可用于电机驱动-Core_PWM, verilog language, can be used for motor drive
(系统自动生成,下载前可以参看下载内容)

下载文件列表

PWM

...\Project

...\.......\PWM

...\.......\...\assert.log

...\.......\...\component

...\.......\...\constraint

...\.......\...\..........\pwm_top.pdc

...\.......\...\..........\top_sdc.sdc

...\.......\...\coreconsole

...\.......\...\designer

...\.......\...\........\impl1

...\.......\...\........\.....\control.adb

...\.......\...\........\.....\control.dtf

...\.......\...\........\.....\control.ide_des

...\.......\...\........\.....\control.tcl

...\.......\...\........\.....\designer.log

...\.......\...\........\.....\designer_genhdl.log

...\.......\...\........\.....\designer_gen_ba.log

...\.......\...\........\.....\simulation

...\.......\...\........\.....\..........\postlayout

...\.......\...\........\.....\..........\..........\stimulus

...\.......\...\........\.....\..........\..........\........\verilog.psm

...\.......\...\........\.....\..........\..........\........\_primary.dat

...\.......\...\........\.....\..........\..........\........\_primary.vhd

...\.......\...\........\.....\..........\..........\tb_clock_minmax

...\.......\...\........\.....\..........\..........\...............\verilog.psm

...\.......\...\........\.....\..........\..........\...............\_primary.dat

...\.......\...\........\.....\..........\..........\...............\_primary.vhd

...\.......\...\........\.....\..........\..........\testbench

...\.......\...\........\.....\..........\..........\.........\verilog.psm

...\.......\...\........\.....\..........\..........\.........\_primary.dat

...\.......\...\........\.....\..........\..........\.........\_primary.vhd

...\.......\...\........\.....\..........\..........\top

...\.......\...\........\.....\..........\..........\...\verilog.psm

...\.......\...\........\.....\..........\..........\...\_primary.dat

...\.......\...\........\.....\..........\..........\...\_primary.vhd

...\.......\...\........\.....\..........\..........\_info

...\.......\...\........\.....\..........\..........\_temp

...\.......\...\........\.....\top.adb

...\.......\...\........\.....\top.dtf

...\.......\...\........\.....\.......\verify.log

...\.......\...\........\.....\top.ide_des

...\.......\...\........\.....\top.pdb

...\.......\...\........\.....\top.pdb.depends

...\.......\...\........\.....\top.tcl

...\.......\...\........\.....\top_ba.sdf

...\.......\...\........\.....\top_ba.v

...\.......\...\hdl

...\.......\...\...\hdlsynchk.tcl

...\.......\...\...\PWM.v

...\.......\...\...\PWM_contr.v

...\.......\...\...\TOP.v

...\.......\...\phy_synthesis

...\.......\...\PWM.prj

...\.......\...\simulation

...\.......\...\..........\meminit.dat

...\.......\...\..........\modelsim.ini

...\.......\...\..........\modelsim.ini.sav

...\.......\...\..........\modelsim.log

...\.......\...\..........\postsynth

...\.......\...\..........\.........\@p@l@l_1

...\.......\...\..........\.........\........\verilog.psm

...\.......\...\..........\.........\........\_primary.dat

...\.......\...\..........\.........\........\_primary.vhd

...\.......\...\..........\.........\@p@w@m

...\.......\...\..........\.........\......\verilog.psm

...\.......\...\..........\.........\......\_primary.dat

...\.......\...\..........\.........\......\_primary.vhd

...\.......\...\..........\.........\control

...\.......\...\..........\.........\.......\verilog.psm

...\.......\...\..........\.........\.......\_primary.dat

...\.......\...\..........\.........\.......\_primary.vhd

...\.......\...\..........\.........\stimulus

...\.......\...\..........\.........\........\verilog.psm

...\.......\...\..........\.........\........\_primary.dat

...\.......\...\..........\.........\........\_primary.vhd

...\.......\...\..........\.........\tb_clock_minmax

...\.......\...\..........\.........\...............\verilog.psm

...\.......\...\..........\.........\...............\_primary.dat

...\.......\...\..........\.........\...............\_primary.vhd

...\.......\...\..........\.........\testbench

...\.......\...\..........\.........\.........\verilog.psm

...\.......\...\..........\.........\.........\_primary.dat

...\.......\...\..........\.........\.....

相关说明

  • 本站资源为会员上传分享交流与学习,如有侵犯您的权益,请联系我们删除.
  • 本站是交换下载平台,提供交流渠道,下载内容来自于网络,除下载问题外,其它问题请自行百度更多...
  • 请直接用浏览器下载本站内容,不要使用迅雷之类的下载软件,用WinRAR最新版进行解压.
  • 如果您发现内容无法下载,请稍后再次尝试;或者到消费记录里找到下载记录反馈给我们.
  • 下载后发现下载的内容跟说明不相乎,请到消费记录里找到下载记录反馈给我们,经确认后退回积分.
  • 如下载前有疑问,可以通过点击"提供者"的名字,查看对方的联系方式,联系对方咨询.

相关评论

暂无评论内容.

发表评论

*主  题:
*内  容:
*验 证 码:

源码中国 www.ymcn.org