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文件名称:基于VHDL的DDS信号发生器

  • 所属分类：
  • 编译
  • 资源属性：
  • 上传时间：
  • 2011-05-04
  • 文件大小：
  • 363byte
  • 下载次数：
  • 0次
  • 提 供 者：
  • meimeisa1
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

本设计是利用EDA技术设计的电路, 该信号发生器输出信号的频率范围为20Hz～20KHz，幅度的峰 峰值为0.3V～5V两路信号之间可实现0°～359°的相位差。侧重叙述了用FPGA来完成直接数字频率合成器(DDS)的设计
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : dds.rar 列表
dds.vhd

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