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文件名称:Example-3-1

  • 所属分类：
  • 其它
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2008-10-13
  • 文件大小：
  • 887byte
  • 下载次数：
  • 0次
  • 提 供 者：
  • x**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

该程序是用quartus II作为开发工具，用verilog语言编写，实现全加器功能的实例。对初学者很有意义
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 51622448example-3-1.rar 列表
Example-3-1\FullAdd.v
Example-3-1\transcript
Example-3-1

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