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原理图/Protel Schematic.pdf
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示例程序/verilog/基础实验/四位比较器/cmp.map.summary
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示例程序/verilog/基础实验/四位比较器/db/cmp.cmp.cdb
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示例程序/verilog/基础实验/四位比较器/db/cmp.cmp.tdb
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示例程序/verilog/基础实验/四位比较器/db/cmp.db_info
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示例程序/verilog/基础实验/多路选择器/.xhdl3.xref
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示例程序/verilog/基础实验/除法器/db/div.eco.cdb
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示例程序/verilog/接口实验/1602LCD/DIV16.v
示例程序/verilog/接口实验/1602LCD/lcd.bsf
示例程序/verilog/接口实验/1602LCD/lcd.v
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示例程序/verilog/接口实验/1602LCD/serv_req_info.txt
示例程序/verilog/接口实验/1602LCD/undo_redo.txt
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示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.cmp.rdb
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.cmp.tdb
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.cmp0.ddb
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.dbp
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.db_info
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.eco.cdb
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.fit.qmsg
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.hier_info
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.hif
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.map.cdb
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示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.psp
示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.rtlv.hdb
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示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.rtlv_sg_swap.cdb
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示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.sld_design_entry.sci
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示例程序/verilog/接口实验/7段数码管/seg71/db/seg71.syn_hier_info
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示例程序/verilog/接口实验/i2c总线/db/i2c.sld_design_entry.sci
示例程序/verilog/接口实验/i2c总线/db/i2c.sld_design_entry_dsc.sci
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示例程序/verilog/接口实验/i2c总线/db/i2c.syn_hier_info
示例程序/verilog/接口实验/i2c总线/db/i2c.tan.qmsg
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示例程序/verilog/接口实验/i2c总线/i2c.v
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示例程序/verilog/接口实验/i2c总线/serv_req_info.txt
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示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.dbp
示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.db_info
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示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.sgdiff.hdb
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示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.sld_design_entry.sci
示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.sld_design_entry_dsc.sci
示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.smp_dump.txt
示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.syn_hier_info
示例程序/verilog/接口实验/PS2/PROJ/db/ps2tolcd.tan.qmsg
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示例程序/verilog/接口实验/PS2/PROJ/div_256.bsf
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示例程序/verilog/接口实验/PS2/PROJ/ps2tolcd.bdf
示例程序/verilog/接口实验/PS2/PROJ/ps2tolcd.cdf
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示例程序/verilog/接口实验/PS2/PROJ/ps2tolcd.fit.rpt
示例程序/verilog/接口实验/PS2/PROJ/ps2tolcd.fit.summary
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示例程序/verilog/接口实验/PS2/SRC/DIV16.v
示例程序/verilog/接口实验/PS2/SRC/div_256.v
示例程序/verilog/接口实验/PS2/SRC/lcd.v
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示例程序/verilog/接口实验/vga/Proj/cmp_state.ini
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示例程序/verilog/接口实验/vga/Proj/ColorBar.fit.rpt
示例程序/verilog/接口实验/vga/Proj/ColorBar.fit.summary
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示例程序/verilog/接口实验/vga/Proj/ColorBar.map.eqn
示例程序/verilog/接口实验/vga/Proj/ColorBar.map.rpt
示例程序/verilog/接口实验/vga/Proj/ColorBar.map.summary
示例程序/verilog/接口实验/vga/Proj/ColorBar.pin
示例程序/verilog/接口实验/vga/Proj/ColorBar.pof
示例程序/verilog/接口实验/vga/Proj/ColorBar.qpf
示例程序/verilog/接口实验/vga/Proj/ColorBar.qsf
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示例程序/verilog/接口实验/vga/Proj/ColorBar.sof
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示例程序/verilog/接口实验/vga/Proj/ColorBar.tan.summary
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.(2).cnf.hdb
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.(3).cnf.hdb
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.asm.qmsg
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.cmp.cdb
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.cmp.tdb
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.cmp0.ddb
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.dbp
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.db_info
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.eco.cdb
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.hier_info
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.hif
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.map.cdb
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.rtlv_sg.cdb
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.rtlv_sg_swap.cdb
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示例程序/verilog/接口实验/vga/Proj/db/ColorBar.signalprobe.cdb
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.sld_design_entry.sci
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.sld_design_entry_dsc.sci
示例程序/verilog/接口实验/vga/Proj/db/ColorBar.syn_hier_info
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示例程序/verilog/接口实验/vga/Src/ColorBar.bdf
示例程序/verilog/接口实验/vga/Src/vga_vl.v
示例程序/verilog/接口实验/串口/cmp_state.ini
示例程序/verilog/接口实验/串口/db/add_sub_3rh.tdf
示例程序/verilog/接口实验/串口/db/add_sub_4rh.tdf
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示例程序/verilog/接口实验/串口/db/mux_1hc.tdf
示例程序/verilog/接口实验/串口/db/prev_cmp_serial.qmsg
示例程序/verilog/接口实验/串口/db/serial.cbx.xml
示例程序/verilog/接口实验/串口/db/serial.db_info
示例程序/verilog/接口实验/串口/db/serial.eco.cdb
示例程序/verilog/接口实验/串口/db/serial.fnsim.cdb
示例程序/verilog/接口实验/串口/db/serial.fnsim.hdb
示例程序/verilog/接口实验/串口/db/serial.fnsim.qmsg
示例程序/verilog/接口实验/串口/db/serial.hier_info
示例程序/verilog/接口实验/串口/db/serial.sld_design_entry.sci
示例程序/verilog/接口实验/串口/db/serial.sld_design_entry_dsc.sci
示例程序/verilog/接口实验/串口/db/serial_cmp.qrpt
示例程序/verilog/接口实验/串口/incremental_db/README
示例程序/verilog/接口实验/串口/serial.asm.rpt
示例程序/verilog/接口实验/串口/serial.cdf
示例程序/verilog/接口实验/串口/serial.done
示例程序/verilog/接口实验/串口/serial.dpf
示例程序/verilog/接口实验/串口/serial.fit.eqn
示例程序/verilog/接口实验/串口/serial.fit.rpt
示例程序/verilog/接口实验/串口/serial.fit.summary
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