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[其它资源] plldigitalclock
说明:此文件是FPGA中数字时钟开发,包括时钟的分拼 ,备品-file is a digital clock FPGA development, including the sub-clock fight, spare<liu> 在 2008-10-13 上传 | 大小:1.2kb | 下载:0
[其它资源] add_32_bcd
说明:此程序采用VHDL语言,完成在32位十六进制加法器的基础上将输出进行BCD码转换,实现输出是BCD码的32位二进制加法器<韩善华> 在 2008-10-13 上传 | 大小:1.2kb | 下载:0