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文件名称:3-8

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 2kb
  • 下载次数：
  • 0次
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  • 阿*
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  • 别用迅雷下载，失败请重下，重下不扣分！
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失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

本文件是利用verilog实现的3-8译码器-This document is the use of Verilog realize the 3-8 decoder
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译码器
vhdl

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