文件名称:ADC1
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用FPGA实现的ADC采样器，用VHDL编写，8个模拟信号通道地址,8位数据输出-Using FPGA to achieve the ADC sampler, using VHDL prepared 8-channel analog signal address, 8-bit data output
(系统自动生成,下载前可以参看下载内容)
下载文件列表
ADC1
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....\ADCINT.done
....\ADCINT.fit.eqn
....\ADCINT.fit.rpt
....\ADCINT.fit.summary
....\ADCINT.flow.rpt
....\ADCINT.map.eqn
....\ADCINT.map.rpt
....\ADCINT.map.summary
....\ADCINT.pin
....\ADCINT.pof
....\ADCINT.qpf
....\ADCINT.qsf
....\ADCINT.qws
....\ADCINT.sof
....\ADCINT.tan.rpt
....\ADCINT.tan.summary
....\ADCINT.VHD
....\db
....\..\ADCINT.asm.qmsg
....\..\ADCINT.cbx.xml
....\..\ADCINT.cmp.cdb
....\..\ADCINT.cmp.hdb
....\..\ADCINT.cmp.qrpt
....\..\ADCINT.cmp.rdb
....\..\ADCINT.cmp.tdb
....\..\ADCINT.cmp0.ddb
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....\..\ADCINT.db_info
....\..\ADCINT.eco.cdb
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....\..\ADCINT.hier_info
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....\..\ADCINT.pre_map.cdb
....\..\ADCINT.pre_map.hdb
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....\..\ADCINT.rtlv_sg_swap.cdb
....\..\ADCINT.sgate.rvd
....\..\ADCINT.sgate_sm.rvd
....\..\ADCINT.sgdiff.cdb
....\..\ADCINT.sgdiff.hdb
....\..\ADCINT.signalprobe.cdb
....\..\ADCINT.sld_design_entry.sci
....\..\ADCINT.sld_design_entry_dsc.sci
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