文件名称:密勒解码器
- 所属分类：
- VHDL编程
- 资源属性：
- [WORD]
- 上传时间：
- 2009-03-18
- 文件大小：
- 207.45kb
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本题的程序参考了 wangliwei同学的设计文档，在此非常感谢他给我学习的机会。好在我自己是抱着学习的态度来参加这次大赛的，所以也不至于说成抄袭:(.
本文在理解wangliwei同学程序的基础上，改写了“检测模块”，重新编写了“解码模块”以及三个测试程序。所以这次虽然交的很晚，但总算是我自己理解的成果，我学到了知识，这就够了。
关于本次程序的一点理解：
(1) 由于给定时钟不完整，“检测模块”中大量使用了“事件触发”，这对综合后的结果肯定会有很大影响，并且不符合同步电路设计的要求，所以仅仅只是功能仿真正确并不能代表程序可用。不知道今年的大赛程序设计部分要求如何，是仅仅只要求功能仿真，还是要求能下载成功？？
(2) “解码模块”中使用“检测模块”的输出信号“BIT_EN_temp”作为时钟信号，这在同步电路设计中也是不容许的。注意到BIT_EN_temp上升沿期间给定的时钟都是连续的，因此可以使用给定时钟作时钟信号，而BIT_EN_temp作为使能信号。
本文在理解wangliwei同学程序的基础上，改写了“检测模块”，重新编写了“解码模块”以及三个测试程序。所以这次虽然交的很晚，但总算是我自己理解的成果，我学到了知识，这就够了。
关于本次程序的一点理解：
(1) 由于给定时钟不完整，“检测模块”中大量使用了“事件触发”，这对综合后的结果肯定会有很大影响，并且不符合同步电路设计的要求，所以仅仅只是功能仿真正确并不能代表程序可用。不知道今年的大赛程序设计部分要求如何，是仅仅只要求功能仿真，还是要求能下载成功？？
(2) “解码模块”中使用“检测模块”的输出信号“BIT_EN_temp”作为时钟信号，这在同步电路设计中也是不容许的。注意到BIT_EN_temp上升沿期间给定的时钟都是连续的，因此可以使用给定时钟作时钟信号，而BIT_EN_temp作为使能信号。
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