文件名称:PPM

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2018-03-22
  • 文件大小:
  • 35kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 王***
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对4比特二进制数据进行PPM调制,位宽可修改(PPM modulation for 4 bit binary data)
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文件名大小更新时间
PPM.qpf 1267 2018-02-01
PPM.v 1487 2018-02-02
simulation 0 2018-02-01
simulation\modelsim 0 2018-03-21
simulation\modelsim\modelsim.ini 11131 2018-02-01
simulation\modelsim\msim_transcript 1993 2018-02-01
simulation\modelsim\PPM.sft 108 2018-02-01
simulation\modelsim\PPM.vo 62478 2018-02-01
simulation\modelsim\PPM.vt 1106 2018-02-01
simulation\modelsim\PPM.vt.bak 2967 2018-02-01
simulation\modelsim\PPM_modelsim.xrf 3250 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak 224 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak1 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak10 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak11 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak2 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak3 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak4 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak5 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak6 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak7 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak8 573 2018-02-01
simulation\modelsim\PPM_run_msim_rtl_verilog.do.bak9 573 2018-02-01
simulation\modelsim\PPM_v.sdo 52224 2018-02-01
simulation\modelsim\rtl_work 0 2018-02-01
simulation\modelsim\rtl_work\@p@p@m 0 2018-02-01
simulation\modelsim\rtl_work\@p@p@m\verilog.prw 1583 2018-02-01
simulation\modelsim\rtl_work\@p@p@m\verilog.psm 5744 2018-02-01
simulation\modelsim\rtl_work\@p@p@m\_primary.dat 518 2018-02-01
simulation\modelsim\rtl_work\@p@p@m\_primary.dbs 1095 2018-02-01
simulation\modelsim\rtl_work\@p@p@m\_primary.vhd 273 2018-02-01
simulation\modelsim\rtl_work\@p@p@m_vlg_tst 0 2018-02-01
simulation\modelsim\rtl_work\@p@p@m_vlg_tst\verilog.prw 1770 2018-02-01
simulation\modelsim\rtl_work\@p@p@m_vlg_tst\verilog.psm 8584 2018-02-01
simulation\modelsim\rtl_work\@p@p@m_vlg_tst\_primary.dat 975 2018-02-01
simulation\modelsim\rtl_work\@p@p@m_vlg_tst\_primary.dbs 1245 2018-02-01
simulation\modelsim\rtl_work\@p@p@m_vlg_tst\_primary.vhd 82 2018-02-01
simulation\modelsim\rtl_work\_info 837 2018-02-01
simulation\modelsim\rtl_work\_temp 0 2018-02-01
simulation\modelsim\rtl_work\_vmake 26 2018-02-01

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