文件名称:vlsi-design3
- 所属分类:
- 硬件设计
- 资源属性:
- 上传时间:
- 2016-12-09
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电路具有四路4_bit字宽的串行输入总线,四路4_bit字宽的输出总线信号的电路。
电路完成将串行输入信号A[3..0]、B[3..0]、C[3..0]、D[3..0](大小排列无序)以数值大小排序输出的功能,输出X3[3..0]、X2[3..0]、X1[3..0]、X0[3..0]中X3最大,X0最小。输入数据是无符号整数。
-Circuit with four 4_bit word wide serial input bus, four 4_bit word wide output bus signal circuit.
Complete the circuit serial input signal A[3..0], B[3..0], C[3..0], D[3..0] (the size of order disorder) to the numerical size of the sort output function, X3[3..0], X2[3..0], X1[3..0] output, X0[3..0] X3 maximum, minimum X0. The input data is an unsigned integer.
电路完成将串行输入信号A[3..0]、B[3..0]、C[3..0]、D[3..0](大小排列无序)以数值大小排序输出的功能,输出X3[3..0]、X2[3..0]、X1[3..0]、X0[3..0]中X3最大,X0最小。输入数据是无符号整数。
-Circuit with four 4_bit word wide serial input bus, four 4_bit word wide output bus signal circuit.
Complete the circuit serial input signal A[3..0], B[3..0], C[3..0], D[3..0] (the size of order disorder) to the numerical size of the sort output function, X3[3..0], X2[3..0], X1[3..0] output, X0[3..0] X3 maximum, minimum X0. The input data is an unsigned integer.
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