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文件名称:roundaclip

  • 所属分类：
  • 数学计算/工程计算
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2016-02-17
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • de***
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  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

自己写的参数化的round和clip数据处理verilog程序，支持有符号数，数学计算时，经常会做饱和截位处理，用这个程序非常方便-Write your own parameterized rand and clip data processing verilog program, with signed numbers, when mathematical calculations, often do saturation cut-bit processing, this program is very easy to use
(系统自动生成,下载前可以参看下载内容)

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round&clip.v

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