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文件名称:single_cpu_verilog

  • 所属分类：
  • 并行运算
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2015-06-12
  • 文件大小：
  • 9kb
  • 下载次数：
  • 1次
  • 提 供 者：
  • ss_c****
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

16位单周期处理器的verilog实现，简单易懂，对计算机的结构学习有帮助。-16 single-cycle processor verilog implement, easy to understand, the structure of learning computer help.
(系统自动生成,下载前可以参看下载内容)

下载文件列表





sccpu

.....\aludec.v

.....\clk_divider.v

.....\controller.v

.....\cpu.v

.....\cpu_test.v

.....\data_mem.v

.....\i_memory.v

.....\instru_mem.v

.....\maindec.v

.....\seg7_controller.v

.....\top_module.v

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