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文件名称:8weijiafaqi

  • 所属分类：
  • GDI/图象编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2014-12-10
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • J*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

8位加法器的verilog实现。VHDL，单片机开发程序，数字逻辑与处理器基础实验，你懂d。-8 adder verilog implementation. VHDL, MCU development program, the digital logic and processor basic experiment, you know d.
(系统自动生成,下载前可以参看下载内容)

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