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文件名称:RX_ASYNC_for_module_UART

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2014-11-06
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • r***
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  • 无
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

Rx Async for module UART written in Verilog Libero Designer core generator.-Rx Async for module UART written in Verilog　Libero Designer core generator.
(系统自动生成,下载前可以参看下载内容)

下载文件列表





RX_ASYNC_for_module_UART.v

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