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文件名称:code

  • 所属分类：
  • 其他小程序
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2014-04-04
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 叶**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

基于Verilog HDL

1、div为分频模块,晶振50M,目的是得到1HZ

2、cnt为异步清零，同步加载，同步使能的十二进制计数器。-4-Bit Binary Up Counter with Asynchronous Clear, Synchronous Load, and Asynchronous En.
(系统自动生成,下载前可以参看下载内容)

下载文件列表





code\cnt.v

....\div.v

....\top.v

....\说明.txt

code

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